dot_product/dot_product/dot_product.v10/dut_vhdl_ports.map


1
2
3
4
5
6

clk 1 std_logic bool
en 1 std_logic sc_logic
arst_n 1 std_logic sc_logic
input_a_rsc_z 8 std_logic_vector sc_lv
input_b_rsc_z 8 std_logic_vector sc_lv
output_rsc_z 8 std_logic_vector sc_lv